第四章 证明在全加器里，进位传递函数。解：并行加法器中的每一个全加器都有一个从低位送来的进位和一个传送给较高位的进位。进位表达式为欲证明，也就是要证明用卡诺图法，图-（a）和-（b）分别是两个逻辑表达式的卡诺图。两个卡诺图相同，两个逻辑表达式就相等，则进位传递函数的两种形式相等。 某加法器采用组内并行、组间并行的进位链， 位一组，写出进位信号C 的逻辑表达式。 设计一个 位先行进位加法器，每 位为一组，采用两级先行进位线路。 已知X 和Y ，试用它们的变形补码计算出X Y ，并指出结果是否溢出。（） X ，Y （） X ，Y （） X ，Y （） X ，Y 已知X 和Y ，试用它们的变形补码计算出X Y ，并指出结果是否溢出。（） X ，Y （） X ，Y （） X ，Y （） X ，Y 9 设下列数据长 位，包括 位符号位，采用补码表示，分别写出每个数据右移或左移 位之后的结果。（） （） （） （） 分别用原码乘法和补码乘法计算X Y 。（） X ，Y （） X ，Y （） X Y ，过程略。 根据补码两位乘法规则推导出补码 位乘法的规则。解：先根据补码 位乘法推出补码 位乘法规则，再根据补码 位乘法推出补码位乘法规则。 分别用原码和补码加减交替法计算X Y 。（） X ，Y （） X ，Y （） X ，Y （） X ，Y 设浮点数的阶码和尾数部分均用补码表示，按照浮点数的运算规则，计算下列各题： 设浮点数的阶码和尾数部分均用补码表示，按照浮点数的运算规则，计算下列各题： 用流程图描述浮点除法运算的算法步骤。 设计一个 位 码加法器。解：设 位被加数为A A A A ，加数为B B B B 。5421码的校正关系如表-所示。